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Rate Limiter

Limiter le taux de variation du signal

  • Rate Limiter block

Bibliothèques :
Simulink / Discontinuities

Description

Le bloc Rate Limiter limite la dérivée première du signal qui le traverse. La sortie ne varie pas plus vite que la limite spécifiée. La dérivée est calculée avec l’équation suivante :

rate=u(i)y(i1)t(i)t(i1)

u(i) et t(i) sont l’entrée et l’heure actuelles du bloc et y(i-1) et t(i-1)) sont la sortie et l’heure du pas précédent. La sortie est déterminée en comparant rate aux paramètres Rising slew rate et Falling slew rate :

  • Si rate est supérieur au paramètre Rising slew rate (R), la sortie est calculée comme suit :

    y(i)=ΔtR+y(i1).

  • Si rate est inférieur au paramètre Falling slew rate (F), la sortie est calculée comme suit :

    y(i)=ΔtF+y(i1).

  • Si rate est compris entre R et F, la variation en sortie est égale à la variation en entrée :

    y(i)=u(i)

Quand le bloc s’exécute en mode continu (par exemple, Sample time mode est à inherited et Sample time est égal à zéro pour le bloc d’origine), Initial condition est ignoré. La sortie du bloc à t = 0 est égale à l’entrée initiale :

y(0)=u(0)

Quand le bloc s’exécute en mode discret (par exemple, Sample time mode est à inherited et Sample time n’est pas égal à zéro pour le bloc d’origine), Initial condition est préservé :

y(1)=Ic

Ic est la condition initiale. La sortie du bloc à t = 0 est calculée comme si rate n’était pas compris entre R et F. Pour t = 0, rate est calculé comme suit :

rate=u(0)y(1)sampletime

Limitations

Ports

Entrée(s)

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Signal d’entrée de l’algorithme de limitation du taux de variation.

Types de données : single | double | int8 | int16 | int32 | int64 | uint8 | uint16 | uint32 | uint64 | fixed point

Sortie(s)

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Signal de sortie de l’algorithme de limitation du taux de variation.

Types de données : single | double | int8 | int16 | int32 | int64 | uint8 | uint16 | uint32 | uint64 | fixed point

Paramètres

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Spécifiez la limite du taux d’augmentation du signal d’entrée. Ce paramètre est réglable pour les entrées à virgule fixe.

Utilisation programmatique

Paramètre de bloc : RisingSlewLimit
Type : vecteur de caractères
Valeurs : nombre réel
Par défaut : '1'

Spécifiez la limite inférieure du taux de diminution du signal d’entrée. Ce paramètre est réglable pour les entrées à virgule fixe.

Utilisation programmatique

Paramètre de bloc : FallingSlewLimit
Type : vecteur de caractères
Valeurs : nombre réel
Par défaut : '-1'

Spécifiez le mode du pas d’échantillonnage, continuous ou inherited à partir du bloc d’origine.

Utilisation programmatique

Paramètre de bloc : SampleTimeMode
Type : vecteur de caractères
Valeurs : 'inherited' | 'continuous'
Par défaut : 'inherited'

Définissez la sortie initiale de la simulation. Simulink® ne vous permet pas de définir la condition initiale de ce bloc à inf ou NaN.

Utilisation programmatique

Paramètre de bloc : InitialCondition
Type : vecteur de caractères
Valeurs : scalar
Par défaut : '0'

Sélectionnez ce paramètre pour que les commandes traitent le gain comme égal à 1. Les commandes de linéarisation de Simulink traitent ce bloc comme un gain dans la représentation d’état. Désélectionnez ce paramètre pour que les commandes traitent le gain comme égal à 0.

Utilisation programmatique

Paramètre de bloc : LinearizeAsGain
Type : vecteur de caractères
Valeurs : 'off' | 'on'
Par défaut : 'on'

Caractéristiques des blocs

Types de données

double | fixed point | integer | single

Traversée directe

oui

Signaux multidimensionnels

non

Signaux de taille variable

non

Détection des passages à zéro

non

Capacités étendues

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Génération de code PLC
Générez du texte structuré avec Simulink® PLC Coder™.

Conversion en virgule fixe
Concevez et simulez des systèmes en virgule fixe avec Fixed-Point Designer™.

Historique des versions

Introduit avant R2006a