Vision HDL Toolbox

 

Vision HDL Toolbox

Concevoir des systèmes de traitement d'images, vidéo et de computer vision pour FPGA et ASIC

 

Vision HDL Toolbox™ contient des algorithmes en streaming au niveau pixel pour la conception et l'implémentation de systèmes de vision sur FPGA et ASIC. La toolbox contient également une infrastructure de design qui supporte différents types d’interfaces, de tailles d'images et de fréquences d'images, y compris la vidéo haute définition (1080p). Ses algorithmes de traitement d'image, vidéo et de computer vision utilisent une architecture adaptée pour les implémentations HDL.

Les algorithmes de la toolbox ont été conçus pour générer du code lisible, synthétisable en VHDL® et Verilog® (avec HDL Coder™). Le code HDL généré peut traiter du 1080p60 en temps réel.

Les fonctionnalités de la toolbox sont disponibles sous forme de System objects™ MATLAB et de blocs Simulink®.

 

Exemples de sous-systèmes hardware

Démarrez avec des exemples de sous-systèmes qui illustrent les techniques d'implémentation hardware des algorithmes de traitement de la vision. Tous sont prêts pour la génération de code Verilog ou VHDL avec HDL Coder.

Conduite autonome

Lancez-vous dans le développement de votre système de conduite autonome avec des sous-systèmes éprouvés sur hardware pour la détection des voies de circulation, la détection des nids-de-poule et le calcul de la disparité stéréo.

Détection des caractéristiques

Apprenez à implémenter des techniques de détection de caractéristiques avec du hardware en streaming pour développer des applications de surveillance, de suivi d'objets, d'inspection industrielle et autres.

Pipeline caméra

Lancez-vous dans la mise au point de votre propre hardware de conditionnement de l'image sur la base d'exemples d'implémentation de la suppression du bruit, de la correction gamma et de l'histogramme.

Conditionnement de l'image pour une application FPGA de détection de contours.

Blocs d'IP de traitement de la vision

Les blocs de propriété intellectuelle (IP) de Vision HDL Toolbox apportent des implémentations hardware efficaces pour des algorithmes en streaming intensifs en calcul souvent implémentés sur du hardware, ce qui vous permet d'accélérer le design de sous-systèmes de traitement d'image et de vidéo.

Traitement de la vision accéléré sur hardware

Modélisez et simulez des implémentations hardware efficaces d'algorithmes de traitement de la vision, notamment pour les conversions, le filtrage, la morphologie et les statistiques. Puis, utilisez HDL Coder pour générer du code RTL VHDL ou Verilog synthétisable.

Bloc Edge Detector adapté au design HDL et ses paramètres configurables.

Gestion intégrée des données hardware

Utilisez des blocs de Vision HDL Toolbox pour gérer automatiquement les données streaming en entrée, telles que les signaux de contrôle, les fenêtres de région d'intérêt (ROI) et les buffers de lignes. Utilisez HDL Coder pour générer du code RTL VHDL ou Verilog pour la fonctionnalité de contrôle que vous modélisez et simulez.

Bufférisation automatique des lignes pour créer une fenêtre ROI pour la détection des contours.

Utilitaires pour l'implémentation hardware

Développez votre propre fonctionnalité de gestion des données hardware avec des blocs utilitaires tels que des buffers de lignes, des sélecteurs de région d'intérêt (ROI), des FIFO et aligneurs de flux de pixels, et des générateurs de bus de signaux de contrôle.

Synchronisation de deux flux de pixels pour le blending alpha.

Vérification à l'aide d'algorithmes basés sur les trames

Associez des algorithmes basés sur les trames et des test benches à l'implémentation hardware en streaming pour une vérification efficace.

Conversion entre trames et pixels

Convertissez la vidéo en trame en un flux de pixels avec des signaux de contrôle pour le traitement sur le hardware. Puis, convertissez la sortie du hardware en streaming en trames pour vérification par rapport à votre algorithme de référence.

Bloc Frame To Pixels pour la conversion des trames d'image en un flux de pixels avec des signaux de contrôle pour le traitement sur le hardware.

Exemples et modèles de vérification MATLAB et Simulink

Découvrez comment utiliser vos algorithmes et tests développés avec Image Processing Toolbox et Computer Vision Toolbox pour vérifier votre implémentation hardware.

Vérification d'une implémentation hardware en streaming à l'aide d'un algorithme basé sur les trames.

Co-simulation HDL et FPGA

Utilisez HDL Verifier™ pour vérifier votre sous-système hardware via une simulation RTL ou sur un kit de développement FPGA connecté à votre environnement de test MATLAB ou Simulink.

HDL Verifier supporte la vérification FPGA-in-the-loop sur cartes FPGA Xilinx®, Intel® et Microsemi®.

Déploiement FPGA, ASIC et SoC

Portez facilement votre application de traitement de la vision sur du hardware FPGA pour la tester avec des entrées vidéo live, et réutilisez les mêmes modèles pour le déploiement en production.

Prototypage de la plateforme avec une entrée vidéo live

Prototypez votre application de traitement de la vision en téléchargeant le support package de Computer Vision Toolbox™ pour le hardware Xilinx® Zynq® et en utilisant HDL Coder et Embedded Coder® pour générer du code depuis votre implémentation MATLAB ou Simulink.

Prototypage de votre design sur du hardware FPGA avec une entrée vidéo live.

Génération de code avec des interfaces d’interconnexion SoC.

Nouveautés

Exemple de pyramide d'image

Générez des flux de pixels redimensionnés à partir d'un flux de pixels en entrée.

Exemple de détection de coins FAST

Détectez les coins à l'aide de l'algorithme FAST (Features from Accelerated Segment Test).

Reportez-vous aux notes de version pour en savoir plus sur ces fonctionnalités et les fonctions correspondantes.

Traitement de la vision sur FPGA

Visionnez cette série de cinq vidéos consacrées au portage des applications de vision sur FPGA, avec présentation des concepts clés et du processus associé.

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