Mixed-Signal Blockset

 

Mixed-Signal Blockset

Concevoir, analyser et simuler des systèmes analogiques et à signaux mixtes

Mixed-Signal Blockset propose des modèles de composants et d'imperfections, des outils d'analyses et des test benches pour le design et la vérification de circuits intégrés à signaux mixtes (IC).

Vous pouvez modéliser des PLL, des convertisseurs de données et d'autres systèmes à différents niveaux d'abstraction. Ces modèles peuvent être utilisés pour simuler des composants à signaux mixtes avec des algorithmes DSP complexes et de la logique de contrôle. Vous pouvez personnaliser ces modèles pour inclure des imperfections, telles que le bruit, la non-linéarité, le jitter et les effets de quantification. La simulation rapide au niveau système utilisant les solveurs Simulink à pas variable permet de débugger l'implémentation et d'identifier les défauts de design sans simuler l'IC au niveau transistor.

Avec l'application Mixed-Signal Analyzer, vous pouvez analyser, identifier des tendances et visualiser des signaux mixtes. L'option d'intégration de Cadence® Virtuoso ADE avec MATLAB permet d'importer dans MATLAB des bases de données de résultats de simulation au niveau circuit. Sinon, vous pouvez importer une netlist SPICE et créer ou modifier un circuit linéaire et invariant avec des éléments parasites extraits du design de l'IC. Le blockset propose des fonctions d'analyse pour le post-traitement des résultats de simulation afin de vérifier les spécifications, d'ajuster les caractéristiques et d'extraire des mesures.

La vidéo dure 2:16

Analyse et optimisation des données

Visualisez, analysez et identifiez les tendances dans les signaux mixtes, de manière programmatique ou interactive, à l'aide de l'application Mixed-Signal Analyzer. L'option Cadence Virtuoso ADE MATLAB Integration vous permet d'importer les résultats de simulation de base de données et d'optimiser la design de votre circuit intégré mixte à partir de MATLAB.

Schéma d'une boucle à verrouillage de phase numérique.

Design d'une boucle à verrouillage de phase

Concevez et simulez des boucles à verrouillage de phase (PLL) au niveau système. Les architectures types comprennent des PLL à division par entier N avec prédiviseurs à module simple ou double et des PLL à division par fraction N avec accumulateurs ou modulateurs delta-sigma. Vérifiez et visualisez la réponse en boucle ouverte et en boucle fermée de vos designs.

Détail du schéma fonctionnel d'un modulateur delta-sigma du quatrième ordre.

Design d'ADC et de DAC

Concevez et simulez des convertisseurs de données analogiques-numériques (ADC) et numériques-analogiques (DAC) au niveau système. Les architectures typiques comprennent des modulateurs delta-sigma, des convertisseurs analogique-numérique (ADC) de type flash et à registre à approximation successive (SAR), ainsi que des convertisseurs numérique-analogique (DAC) à pondération binaire et segmentés.

Bruit de phase et jitter

Modélisez le jitter d'horloge et d'ouverture dans les ADC et spécifiez des profils de bruit de phase arbitraires dans le domaine fréquentiel pour les VCO et les PLL. Effectuez des mesures d’oeil ainsi qu’une décomposition du jitter sur des formes d'onde arbitraires.

Test d'un ADC SAR avec un test bench ADC.

Mesures et test benches

Mesurez le temps de verrouillage, le profil de bruit de phase et la fréquence de fonctionnement des PLL. Caractérisez les performances des blocs de base tels que les VCO, les PFD et les pompes de charge. Mesurez les caractéristiques AC et DC et le jitter d'ouverture des ADC.

Huit blocs de base utilisés pour réaliser des PLL.

Modèles comportementaux

Concevez votre système à signaux mixtes à l'aide de blocs de base tels que des pompes de charge, des filtres de boucle, des détecteurs de fréquence de phase (PFD), des oscillateurs commandés en tension (VCO), des diviseurs d'horloge et des sources d'horloge d'échantillonnage. Vous pouvez ajuster plus précisément des modèles analogiques à un niveau d'abstraction inférieur avec Simscape Electrical.

« Auparavant, nous ne savions pas comment nos designs allaient réagir au jitter avant de les tester sur la puce. Maintenant que nous effectuons des simulations au niveau du système avec des modèles à temps discret et continu dans Simulink, lorsque nous réalisons le tapeout d'une puce, nous sommes sûrs qu'elle va fonctionner. »