I am using workflow advisor (MARTLAB 2021a), i have generated the vhdl code succesfuly and create the project using Vivado 2019.2 as third-party software, but in the synthesis it stucks and never ends (i let it for 14h), where could be the problem?
It is possible you have very high resource usage or timing issue with your generated code.
You should consider using high level estimation to see how much of percentage of resources (multipliers, RAMs etc.,) are consumed before going to synthesis.
High Level Resource Estimation Report from HDL Coder
Actual Synthesis Report Summary in HDL Coder
You may large critical path or too much wiring delays leading to timing failures that synthesis tool fail to close and trying too hard. You should consider using critical path estimation report to asses this situation before going to synthesis.
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